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Viveris

Viveris

FrancePublication : 22 oct. 2026

Optimisation de la bande passante de transfert de données d’imagerie

  • Stage
  • 4-6 mois
  • Présentiel
  • Échéance : 5 nov. 2026
  • image compression
  • FPGA Engineering
  • cpu
  • VHDL
  • PLC Programming (TIA)
  • Convolutional Neural Networks
  • hls

Description du poste

Implémentation d’un scénario de compression basé sur un réseau de neurones sur cible spatialisable CPU/FPGA. Utilisation d’Aidge pour créer les opérateurs unitaires et de LoCod pour la partie HLS bas niveau (modèle de J. Ballé).

Environnement technique

  • Langage: C
  • Technologies: HDL, CPU, FPGA
  • Outils: Aidge, LoCod

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