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Viveris

Viveris

FrancePublished: 22 Oct 2026

Optimisation de la bande passante de transfert de données d’imagerie

  • Internship
  • 4-6 months
  • On-site
  • Deadline: 5 Nov 2026
  • image compression
  • FPGA Engineering
  • cpu
  • VHDL
  • PLC Programming (TIA)
  • Convolutional Neural Networks
  • hls

Job description

Implémentation d’un scénario de compression basé sur un réseau de neurones sur cible spatialisable CPU/FPGA. Utilisation d’Aidge pour créer les opérateurs unitaires et de LoCod pour la partie HLS bas niveau (modèle de J. Ballé).

Environnement technique

  • Langage: C
  • Technologies: HDL, CPU, FPGA
  • Outils: Aidge, LoCod

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